【摘 要】
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该文介绍的“组合电路和时序电路特征参数的提取”的方法是该系统中的一个重要组成部分.作者通过对目前比较成熟通用的测试生成算法的运行过程进行分析,并对可测性设计方法进
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该文介绍的“组合电路和时序电路特征参数的提取”的方法是该系统中的一个重要组成部分.作者通过对目前比较成熟通用的测试生成算法的运行过程进行分析,并对可测性设计方法进行了深入的研究,结合对标准电路ISCAS-85和ISCAS-89的分析,获得了电路中影响测试生成算法的一些特征参数.结合上述研究,作者开发了“组合电路与时序电路特征参数提取系统”.该系统将组合电路的12个特征参数和时序电路的16个特征参数从电路网表中分别提取出来,使得“测试生成算法评估与预报系统”仅需根据用户提供的被测电路网表,即可测算出电路的可测性参数值,并进行评估,从而快速地得到给定电路最有效的测试生成算法.该文所介绍的方法提取的特征参数,是“测试生成算法评估与预报系统”运行的基础.该文详细地阐述了提取这些参数的过程和相关算法.希望该文对从事测试方面的研究人员和集成电路设计人员在分析决定测试生成算法效率的主要因素,以及这些因素是如何影响测试生成效率等方面有所帮助,同时也为集成电路设计人员设计出高可测性的电路提供了理论依据.
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