(深)亚微米工艺下互连线时延估算及其在布图设计中的应用

来源 :杭州电子工业学院 杭州电子科技大学 | 被引量 : 0次 | 上传用户:chungkhoan2002
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传统或近年来流行的各种时延估算算法各有所长,但是,始终未能很好解决精度和效率的矛盾.我们提出一种基于传递函数递推和系数匹配的互连线网时延估算法,用二极点模型逼近互连线网的传递函数,仅通过计算某一频率点上的传递函数,就可利用导出的解析公式或拟合的经验公式进行快速时延估算,不必进行复杂的分量计算.为满足不同精度需求,将所得计算结果作为初值,采用基于NILT的迭代优化算法,提高精度.算例表明,对于各个电压门限值,其计算结果均与PSPICE计算的时延十分接近,计算量也比通常基于分量计算的估算法大为减少,在计算效率和模拟精度两方面得到较好折衷,对于互连线网时延估算具有实用价值.同时,我们将我们提出的时延估算算法应用于布图设计中,实现布线阶段任意两个源节点与目标节点之间的时延估算.我们在算法上实现了单元布线中任意两端口之间的延迟计算模拟,将版图中互连线用有耗传输线等效,有耗传输线的特征参数根据版图中各布线层的相关工艺参数提取,通孔、接触端口等根据其在电路中的作用采用电容等效,并根据连接关系将多维布线结构图连接成与之相应的二维的可模拟电路,然后用我们提出的算法计算该目标接点和源点之间的时延.结果表明该算法精确而有效,可用于(深)亚微米ASIC/SOC互连优化布图设计中的时延估算,也可为布局布线提供关键路径时延验证.
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