【摘 要】
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使用3μm标准CMOS工艺设计制作了一种高速比较器。在动态锁存器之前使用了一种失调消除放大器,可获得43ns的响应时间。这种失调消除放大器可降低输入失调,所以用这种比较器可
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使用3μm标准CMOS工艺设计制作了一种高速比较器。在动态锁存器之前使用了一种失调消除放大器,可获得43ns的响应时间。这种失调消除放大器可降低输入失调,所以用这种比较器可构成中等分辨率的模拟/数字转换器(ADC)。在比较器内使用流水线结构可以使失调消除在动态锁存器启动时进行。另外,对放大器内的功耗和面积采用了最佳分布,以便使响应时间达到最小。
Using 3μm standard CMOS process design and manufacture of a high-speed comparator. An offset cancellation amplifier was used prior to the dynamic latch for 43ns response time. This offset cancellation amplifier reduces the input offset so that this comparator can be used as a medium-resolution analog-to-digital converter (ADC). Using a pipelined architecture within the comparator allows offset cancellation to occur when the dynamic latch is started. In addition, the optimal distribution of power consumption and area within the amplifier is used in order to minimize the response time.
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