基于IBIS模型的高速电路信号完整性研究

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该文在建立IBIS模型的基础上对高速电路信号完整性问题展开了研究.第二章针对工作几十兆赫兹以下的高速互连电路,采用优化拟合方法将Buffer的IBIS模型参数转换成组成Buffer的MOS管和二极管的Spice标准模型的参数并同时得到寄生电感、寄生电阻、寄生电容和伴随电容的模型参数.在第三章,针对工作在GHz以上的高速互连电路,给出了一种方法采用最新版本IBIS数据构建一个可以直接用于SPICE的高速数字I/O缓冲器瞬态行为模型,并给出了基于两对开关VT(电压对时间)表的更加精确的模型,同时获得了基于一对开关VT表精确建模所需要的充分条件.第四章首先证明了非时变线性电路元件对改进结点法异纳矩阵[Y]的贡献也是非时变的.在论文第五章后面部分采用ABCD矩阵法传输高速信号的背板上具有频变参数的互连线建立等效时域网络模型,与接插件等效传输线模型和端接的I/O缓冲器IBIS瞬态行为模型一起,对实际电路进行仿真,其结果与Ansoft公司的PNC软件的仿真结果相吻合,最后,给出了评估信道品质的伪随机信号眼图.该文第六章在改进节点法(MNA)的传输线模型和灵敏度分析模型的基础之上,采用了基于BFGS拟牛顿法和有效集方法的Han-Powell法(亦称为序列二次规划SQP法)优化方法,同时实现了对高速集成互连电路的信号延时、过冲/过欠、串扰以及芯片内同步开关噪声的优化.
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