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这是一个重复发生的恶梦.一个SoC(单片系统)设计从第一天起就很顺利、每个块的RTL(寄存器传输级)都按时完成、综合做得几乎完美无缺、功能验证更是无可挑剔、布局与布线也没有问题.现在,时序提取后期报告返回来了,竞有75000个失败网表.
SoC设计时序至关重要
【摘 要】
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这是一个重复发生的恶梦.一个SoC(单片系统)设计从第一天起就很顺利、每个块的RTL(寄存器传输级)都按时完成、综合做得几乎完美无缺、功能验证更是无可挑剔、布局与布线也没
【出 处】
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电子设计技术
【发表日期】
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2007年4期
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