【摘 要】
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通过介绍C++语言配合Verilog HDL来进行数字逻辑设计的模式,提出了一种由C++到Verilog来实现逻辑设计的崭新方法.此方法从系统设计(虚拟机)入手,用C++来搭建所需要的系统模型
【机 构】
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辽宁大学物理学院,北京美新华微电子技术有限公司
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通过介绍C++语言配合Verilog HDL来进行数字逻辑设计的模式,提出了一种由C++到Verilog来实现逻辑设计的崭新方法.此方法从系统设计(虚拟机)入手,用C++来搭建所需要的系统模型,再由Verilog与C++的一致性转化,将软件设计精确地转化到硬件级上,使得逻辑设计向上可进行软硬件的联合仿真,向下能够实现物理级延伸.通过该方法可有效地避免SOC设计中从系统到物理实现在转化过程中产生的逻辑不一致.在简叙C++的语言特性后,将Verilog与C++进行了对比分析,给出了两种语言之间进行转化设计的实现方式.结合数字信号处理器的设计,对此方法进行了设计应用,最终通过比对C++与Verilog两者的仿真数据文件,对两种层次系统描述进行了测试验证.
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