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在传统的定点数流水线型CORDIC算法基础上,就减少迭代次数上提出一种改进算法,实现并行处理时的符号预测。改进算法大大减少了流水线迭代次数,节省了FPGA的Slice Flip Flops数量。最后利用改进算法在Xilinx公司的Virtex-II平台上实现了直接数字频率合成器（DDS）。
改进的CORDIC模块实现的直接数字频率合成器
【摘 要】
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在传统的定点数流水线型CORDIC算法基础上,就减少迭代次数上提出一种改进算法,实现并行处理时的符号预测。改进算法大大减少了流水线迭代次数,节省了FPGA的Slice Flip Flops
【机 构】
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中南大学信息科学与工程学院
【出 处】
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计算机工程与应用
【发表日期】
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2010年17期
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