【摘 要】
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本文概述了MOS电路版图设计,提出了一种有效的栅保护结构,给出了新旧版图实验结果的比较。新设计的五种版图与旧版图相比:芯片尺寸缩小一倍,芯片数目增加一倍,平均合格电路数
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本文概述了MOS电路版图设计,提出了一种有效的栅保护结构,给出了新旧版图实验结果的比较。新设计的五种版图与旧版图相比:芯片尺寸缩小一倍,芯片数目增加一倍,平均合格电路数目增加三至六倍,总平均成品率从原来的10～25%提高到45～55%。
In this paper, the layout of the MOS circuit is outlined, an effective gate protection structure is proposed, and the experimental results of new and old versions are compared. The five designs of the new design are compared with the previous version: the chip size is reduced by one time, the number of chips is doubled, the average number of qualified circuits is increased by three to six times, and the overall average yield is increased from 10-25% to 45-55 %.
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