【摘 要】
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在数字设计中,常常遇到一些对时钟分频的需求,其中包括整数分频,半整数分频和小数分频等。本文就针对这些分频需求,介绍了基于FPGA/CPLD的多种分频器的原理及其设计方法,并以
【机 构】
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华北电力大学计算机科学与技术系 北京102206
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在数字设计中,常常遇到一些对时钟分频的需求,其中包括整数分频,半整数分频和小数分频等。本文就针对这些分频需求,介绍了基于FPGA/CPLD的多种分频器的原理及其设计方法,并以VerilogHDL加以实现,通过仿真验证其正确性。
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