一种AMR语音编码器的VLSI设计及FPGA实现

来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户：bestdzik

【摘要】

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AMR（自适应多速率）语音编码标准由于其低码率和高质量，在通信和多媒体领域得到广泛应用．针对AMR语音编码标准的算法特点，提出了一种“音频DSP软核＋硬件加速器”的VLSI实现结构．这种

【作者】

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郑海东王明江王进祥崔浩林商迪

【机构】

：

哈尔滨工业大学微电子中心

【出处】

：

微电子学与计算机

【发表日期】

：

2010年2期

【关键词】

：

AMR VLSI DSP软核硬件加速器 FPGA AMR VLSI DSP soft core hardware accelerator FPGA

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AMR（自适应多速率）语音编码标准由于其低码率和高质量，在通信和多媒体领域得到广泛应用．针对AMR语音编码标准的算法特点，提出了一种“音频DSP软核＋硬件加速器”的VLSI实现结构．这种结构能够有效地实现编码算法，同时达到低成本、低功耗的要求．综合后的电路在满足语音编码实时性的要求下能工作在50MHz频率以下，功耗仅有不到50mW，和78k门的芯片面积．最后通过FPGA整体验证，证明这种方案是可行有效的．同时优化后的音频DSP软核和硬件加速器中的模块复用设计，使得本设计方案对G．7xx系列编码算法具有通用

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