【摘 要】
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为了降低硬件开销,越来越多的加法器电路采用传输管逻辑来减少晶体管数量,同时导致阈值损失、性能降低等问题.本文通过对摆幅恢复逻辑与全加器电路的研究,提出一种基于摆幅恢
【机 构】
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宁波大学信息科学与工程学院,中国人民武装警察部队海警学院电子技术系
【基金项目】
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国家自然科学基金资助项目(61871244,61874078),浙江省自然科学基金资助项目(LY18F040002),宁波大学王宽诚幸福基金,宁波大学教学研究资助项目(JYXMXYB201934),宁波大学研究生科研创新资助基金(2019SRIP1335)
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为了降低硬件开销,越来越多的加法器电路采用传输管逻辑来减少晶体管数量,同时导致阈值损失、性能降低等问题.本文通过对摆幅恢复逻辑与全加器电路的研究,提出一种基于摆幅恢复传输管逻辑(Swing restored pass transistor logic,SRPL)的全加器设计方案.该方案首先分析电路的阈值损失机理,结合晶体管传输高、低电平的特性,提出一种摆幅恢复传输管逻辑的设计方法;然后,采用对称结构设计无延时偏差输出的异或/同或电路,利用MOS管补偿阈值损失的方式,实现异或/同或电路的全摆幅输出;最后,将
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