【摘 要】
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本文讨论了用于逻辑电路故障测试的一个扩充D算法。该算法是面向由CHDL(计算机硬件描述语言)说明功能的,包含功能模块的电路。本文着重分析不同CHDL结构中的D传播。由于提高
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本文讨论了用于逻辑电路故障测试的一个扩充D算法。该算法是面向由CHDL(计算机硬件描述语言)说明功能的,包含功能模块的电路。本文着重分析不同CHDL结构中的D传播。由于提高了硬件级别和采用功能故障模型,该算法可用于规模较大的电路的测试生成。
This article discusses an extended D algorithm for logic circuit failure testing. The algorithm is intended for circuits containing functional blocks that are described by CHDL (Computer Hardware Description Language). This article focuses on the analysis of D propagation in different CHDL structures. Due to the increased hardware level and the functional failure model, the algorithm can be used for test generation of larger circuits.
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