【摘 要】
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针对现有高速串行接口协议复杂、数据效率低的问题,基于ESIstream协议,提出一种应用于12～14位ADC/DAC新型收发接口的设计方案.采用14B/16B编解码算法,降低了数字电路的设计复
【机 构】
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重庆邮电大学,重庆400065;模拟集成电路国家重点实验室,重庆400060;模拟集成电路国家重点实验室,重庆,400060
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针对现有高速串行接口协议复杂、数据效率低的问题,基于ESIstream协议,提出一种应用于12～14位ADC/DAC新型收发接口的设计方案.采用14B/16B编解码算法,降低了数字电路的设计复杂度,将有效数据率提高到87.5％.加解扰器中,LFSR采用斐波纳契结构和多项式X17+X3+1来并行设计,降低了LFSR的工作时钟频率.采用Modelsim软件进行功能验证,并基于Design Compiler平台,采用TSMC 65 nm工艺库对电路进行综合.结果 表明,该收发电路的单通道传输速度可达6.4 Gbit/s.
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