基于CPLD的FPGA从并快速加载方案

来源 :中兴通讯技术 | 被引量 : 2次 | 上传用户：deansam

【摘要】

：

提出了基于复杂可编程逻辑器件(CPLD)的现场可编程门阵列(FPGA)从并加载方案,及逻辑代码的实现过程,并给出仿真结果。该方案理论计算结果表明,当加载SPARTAN-6系列最高端的6SLX150T时,采用基于CPLD的从并加载方式,共需要加载时间为1.221 s,完全满足通信产品的快启动要求,具有较高的应用价值。

【作者】

：

李春雨

【出处】

：

中兴通讯技术

【发表日期】

：

2014年04期

【关键词】

：

FPGA CPLD 控制器从并加载启动 FPGA CPLD controller salve parallel loading boot

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