基于Astro的时钟树综合

来源 :电子器件 | 被引量 : 0次 | 上传用户：fengsuiyu

【摘要】

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时钟树综合是芯片后端设计至关重要的一环,时钟偏差成为限制系统时钟频率的主要因素.本文以一款TSMC 0.25 μm工艺的RISC微处理器芯片为例,介绍了使用Synopsys公司的 P&R工具

【作者】

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周凤亭王胤翔陆生礼

【机构】

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东南大学国家专用集成电路系统工程技术研究中心

【出处】

：

电子器件

【发表日期】

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2005年1期

【关键词】

：

时钟树综合 SOC 时钟偏差 clock tree synthesis SoC clock skew

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时钟树综合是芯片后端设计至关重要的一环,时钟偏差成为限制系统时钟频率的主要因素.本文以一款TSMC 0.25 μm工艺的RISC微处理器芯片为例,介绍了使用Synopsys公司的 P&R工具Astro进行时钟树综合和优化的方法,并与Silicon Ensemble在综合后的时钟偏差上作了对比,结果显示使用前者比后者时钟偏差减小百分之十四以上.

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