【摘 要】
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现在的芯片技术已经到达几千万晶体管数量级、七层铜互连.连线上的电容电感效应随着信号频率的上升越来越突出,互连线延迟所占的比重已经超过了单元延迟的比重,时钟信号的偏
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现在的芯片技术已经到达几千万晶体管数量级、七层铜互连.连线上的电容电感效应随着信号频率的上升越来越突出,互连线延迟所占的比重已经超过了单元延迟的比重,时钟信号的偏差已经比系统的延时更加重要.对于高频时钟电路来说,很重要的一个问题是时钟信号能否从时钟源出发完整的到达各个时钟接收端点.另一方面,如果时钟信号不能在指定时刻到达时钟端点,电路的时序就被打乱,电路就不能正常工作.如何完成时钟分布电路的综合是学术界和工业界所迫切需要研究的课题.在宋的应用背景下,我们的目标是要在单层平面上实现时钟分布电路的构造,使得GHz时钟信号从时钟源没有偏差的、完整的传输到每一个时钟接收端点,并且尽可能的减少插入的缓冲器数目.该论文介绍了我们先后开发的一套面向IP的GHz零时滞时钟树物理综合软件原型ClockStar1.0和ClockStar2.0,作者是主要的开发者和管理者.采取流水线技术解决较长连线传送信号完整性的问题,提出了两种布图算法：模式匹配布线算法以及虚拟通道布线算法以完成时钟树的平面布线;并在基于理想缓冲器模型和有损传输线模型的快速全波形模拟器基础上,对缓冲器采用非线性的晶体管模型,模拟带缓冲器的时钟树.
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