【摘 要】
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随着目前数字系统之间传输速率达到Gbps级,高速率下的数据传输稳定性与准确性成为评价数字系统是否正常、稳定工作的重要判据,其中数字信号在时序上的抖动成为影响数据在高速率下正确传递的关键因素。本论文基于“数字系统抖动特征的快速提取与抖动注入校正方法与技术研究”和“定时数据发生器”课题中,要求对数据码型产生多种类型的幅度、频率可控的抖动,在现有抖动研究基础上,研究如何精确的向数据码型针对性的产生抖动分
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随着目前数字系统之间传输速率达到Gbps级,高速率下的数据传输稳定性与准确性成为评价数字系统是否正常、稳定工作的重要判据,其中数字信号在时序上的抖动成为影响数据在高速率下正确传递的关键因素。本论文基于“数字系统抖动特征的快速提取与抖动注入校正方法与技术研究”和“定时数据发生器”课题中,要求对数据码型产生多种类型的幅度、频率可控的抖动,在现有抖动研究基础上,研究如何精确的向数据码型针对性的产生抖动分量,以满足现代数字信号领域中高速数字系统的抖动性能测试。本论文主要对以下方面进行了研究:（1）对数字信号的抖动从时域、频域与统计域特性进行了分析,并结合课题指标要求与技术难点,针对性的对数字系统中数字信号的幅度噪声到时序抖动的转换,电路中串扰、反射或其他信号完整性问题引起的时序抖动进行了分析,以减小抖动产生模块本身引入的不期望的抖动。（2）对基于模拟调制抖动产生方法与基于PLL结构的抖动产生方法进行原理性研究,设计了相关电路和搭建相关平台进行测试,并结合课题指标要求,对其中抖动幅度与频率之间耦合的问题以及电路本身引入不期望的噪声过抖动大分析了其原因。（3）提出基于数字合成和DTC数字时间转换技术的标准数字抖动产生方法并设计相关电路,实现了项目指标要求的在10MHz～2Gbps数据率的数据码型上产生正弦、方形、三角与高斯噪声抖动,抖动频率覆盖范围为0.015Hz～1.56MHz、幅度覆盖范围为30ps～16.5ns,且可实现门控信号下部分码型的全部码型加抖的功能。（4）从电源完整性与信号完整型出发,研究如何通过设计上的改善,降低电路本身引入的抖动与噪声,使模块在不对数据码型产生抖动时输出信号中随机抖动仅2.77ps,以满足项目指标要求对Gbps级数据码型产生最小30ps幅度的抖动,保证产生抖动不被噪声或串扰等因素引起的不期望的抖动淹没,使产生的抖动标准化。
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