【摘 要】
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文章首先介绍了一种由数字计数器构成的延迟脉冲产生电路的结构,详细分析了这种延迟产生电路的误差来源、特性和适用场合;其后分析了AD9501和DS1020两种数字可编程模拟延迟线
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文章首先介绍了一种由数字计数器构成的延迟脉冲产生电路的结构,详细分析了这种延迟产生电路的误差来源、特性和适用场合;其后分析了AD9501和DS1020两种数字可编程模拟延迟线的内部结构和特点.在对多种数字和模拟的延迟产生电路的结构、性能和适用范围作了深入的比较和分析后提出了一种数字延迟加模拟延迟的两级延迟产主方案.数字延迟部分由一个25比特数字计数器实现,模拟延迟分别采用了AD9501和DS1020两种方案.文章对多种可编程逻辑器件特别是现场可编程门阵列(FPGA)和复杂可编程逻辑器器件(CPLD)的内部结构和应用特点做了充分的分析、比较后选择了Altera公司的CPLD-EPM7128S作为数字延迟的实现载体.文章结合EPM7128S的内部逻辑结构特点,分析了综合于一片CPLD-EPM7128S-15内的数字延迟脉冲产生电路单元的工作原理.软件部分综合介绍了X5045和LCD(HD44780)的软件编程和基于RS232的远程控制流程的单片机软件和PC机远程控制软件的编写.文章最后对高速数字系统中的电源分布,电源滤波和传输线阻抗匹配问题也做了相应的讨论.
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