【摘 要】
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锁相环问世至今己经有近百年历史,在当今电子系统中的应用变得越来越广泛.其中高性能的锁相环是现代模拟电路设计的难点.但是国产锁相环产品不仅寥寥无几而且质量不佳,所以高
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锁相环问世至今己经有近百年历史,在当今电子系统中的应用变得越来越广泛.其中高性能的锁相环是现代模拟电路设计的难点.但是国产锁相环产品不仅寥寥无几而且质量不佳,所以高性能锁相环的研究对提高我国模拟电路设计水平有非常重要的意义.该文设计了一个用于光纤通讯同步数字系列（SONET/SDH）系统的高速时钟数据恢复芯片的多环路锁相环.采用对系统的零点进行调整的方法进行系统设计,将三个环路合并到一个系统中,降低了电路的规模,缩小了集成电路的面积.该文对三个环路的稳定性、噪声、带宽等指标进行系统地分析并用Cadence模拟电路仿真工具进行仿真.在设计电路时选用了对外界干扰有较好抑制能力的射极耦合逻辑（LVPECL）的基本电路结构,电路设计过程中注意抑制各种噪声,仿真结果表明我们的锁相环达到预期设计性能并且有较理想噪声抑制能力.
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