【摘 要】
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该文详细地评价了当前国内外前向纠错(FEC)通信系统中卷积码的Viterbi译码的新方法和新进展.对串行Viterbi译码的简化方法--简化Viterbi译码方法从一次接收的最佳分支数、译
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该文详细地评价了当前国内外前向纠错(FEC)通信系统中卷积码的Viterbi译码的新方法和新进展.对串行Viterbi译码的简化方法--简化Viterbi译码方法从一次接收的最佳分支数、译码速率、误码性能以及渐近特性等方面进行了理论分析.为了最大限度提高简化Viterbi译码的译码速率,同时又使路径存储器的管理具有规则性,一次接收的最佳分支数为m,(m为卷积码的编码存储级数);简化Viterbi译码在不牺牲大多性能增益的前提下,平均译码运算量仅是Viterbi译码的一半;其首错误码率的上限小于两倍的Viterbi译码的可靠性.同时,该文还研究了用信号处理器TMS320C25实现简化Viterbi译码的软硬件设计,对各部分电路的设计要求及电路选择、软硬件配置作了深入的分析.最后进行了计算机模拟.
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