【摘 要】
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该文介绍了时钟数据恢复（COR）电路的设计方法,并具体给出了一个2Gb/s的时钟数据恢复电路的设计.设计中采用了半速率线性鉴相器和差分放大器形式的电荷泵,使得该文的设计和传统
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该文介绍了时钟数据恢复（COR）电路的设计方法,并具体给出了一个2Gb/s的时钟数据恢复电路的设计.设计中采用了半速率线性鉴相器和差分放大器形式的电荷泵,使得该文的设计和传统的时钟数据恢复的设计有着显著的差别.对于某种给定的工艺可以设计出2倍于传统结构的速率的CDR电路.论文在介绍时钟数据恢复电路的设计流程和一般方法的基础上,给出了检验系统抖动峰值（jitter peaking）的方法,从而可以从理论上估计所设计系统的抖动峰值的大小.论文中的CDR电路采用了单环路结构,这在有些应用场合是不能达到令人满意的结果,因此可以在此基础上添加鉴频环路,使电路成为双环路结构,以提高系统的工作性能.同时随着应用要求的提高,压控振荡器的设计可以考虑采用LC振荡器来实现.
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