【摘 要】
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该论文设计了一个内核库-嵌入式SRAM编译器,它可以根据用户输入的各种性能参数及环境变量,产生相应的SRAM的行为级模型(VHDL及VerilogHDL模型)、符号模型(Symbol)、用于自动
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该论文设计了一个内核库-嵌入式SRAM编译器,它可以根据用户输入的各种性能参数及环境变量,产生相应的SRAM的行为级模型(VHDL及VerilogHDL模型)、符号模型(Symbol)、用于自动布局布线的端口模型(Abstract)、版图及测试向量等输出文件.该编译器完全在Cadence平台上设计完成,并用Skill语言将其嵌入Cadence中,能为Cadence的设计流程提供所需要SRAM的各个层次的模型.该文对该编译器的设计流程、库单元设计、行为级模型设计、版图设计、符号(symbol)设计、用于自动布局布线的端口模型设计和测试向量生成等各方面作了较详尽的论述.通过对SRAM编译器的设计,该论文还总结了一套在Cadence平台上如何 设计内核库的方法,对于类似编译器的设计,例如Datapath Compiler、ROMCompiler、MultiplexerCompiler等将会有一定的借鉴意义.
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