【摘 要】
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本文从差分环形振荡器的噪声分析入手,在0.13um数字CMOS工艺下设计并实现了一款30相、中心频率500MHz的VCO。设计结果的Spice模拟结果表明该VCO具有较小的调谐范围、适中的线
【出 处】
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第十一届计算机工程与工艺全国学术年会
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本文从差分环形振荡器的噪声分析入手,在0.13um数字CMOS工艺下设计并实现了一款30相、中心频率500MHz的VCO。设计结果的Spice模拟结果表明该VCO具有较小的调谐范围、适中的线性度范围、较低的压控灵敏度和良好的抗噪声性能,能很好的适用于5Gb/s的3倍过采样CDR电路中的PLL电路。
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