【摘 要】
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本文设计了一款应用于MB64-1的浮点部件,实现了双精度浮点数比较、加/减法、乘法、除法、整数/浮点转换、开方操作,并运用流水线技术对设计进行了优化.加法器采用四级流水化
【机 构】
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国防科技大学计算机学院 长沙410073
【出 处】
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第十五届计算机工程与工艺年会暨第一届微处理器技术论坛
论文部分内容阅读
本文设计了一款应用于MB64-1的浮点部件,实现了双精度浮点数比较、加/减法、乘法、除法、整数/浮点转换、开方操作,并运用流水线技术对设计进行了优化.加法器采用四级流水化的单通路结构实现,乘法器采用四级流水化的部分积相加结构实现,整数转浮点采用四级流水线结构实现,浮点转整数采用五级流水线结构实现,除法器和开方采用不恢复余数算法实现.最后用VHDL语言对各个运算单元进行了逻辑描述,用Xilinx公司的ISE软件进行了功能验证和综合,结果表明,其在Virtex-5系列FPGA开发板上模拟运算频率为101.6MHz.
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